一、虚焊与立碑：焊接缺陷的"设计根源"
在PCBA打样与批量生产中，虚焊（Cold Joint / Insufficient Solder） 和 立碑（Tombstoning / Manhattan Effect） 是出现频率最高的两类焊接缺陷，轻则导致电路功能异常，重则引发产品批量报废。
许多工程师习惯将问题归结于SMT工艺或焊膏质量，但根据IPC-7711/7721及行业实践数据，超过60%的虚焊与立碑问题，根源可追溯至PCB设计阶段——焊盘尺寸不合理、布局热不平衡、钢网开口设计失当等，都会为后续生产埋下隐患。
二、虚焊的成因与PCB设计阶段的预防策略
1. 焊盘尺寸设计不当
焊盘过大会导致焊膏摊开过薄、焊接热量分散，焊点难以形成良好熔融；焊盘过小则焊膏不足，同样形成虚焊。
设计建议：
- 严格参照IPC-SM-782《表面贴装设计与焊盘图形标准》，根据元器件封装类型（0201、0402、SOT、QFP、BGA等）匹配推荐焊盘尺寸；
- BGA封装焊盘直径建议为球径的80%～90%，并注意NSMD（非阻焊限定）与SMD（阻焊限定）焊盘的选用场景。
2. 铜箔散热不均衡（热不对称）
当焊盘连接的铜箔面积或过孔数量不对称时，回流焊过程中两端升温速率不同，导致焊膏熔化时间差，轻则虚焊，重则立碑。
设计建议：
- 小封装元件（0402及以下）的两端焊盘应等面积、等铜箔延伸，避免一端连接大铜皮或多个过孔；
- 若焊盘必须连接地平面，建议使用热焊盘（Thermal Relief） 设计，减少散热过快导致的冷焊。
3. 过孔与焊盘共用（Via-in-Pad）处理不当
设计中将过孔直接放置在焊盘内，回流焊时焊膏会沿孔壁流失，造成焊点空洞或虚焊。
设计建议：
- 高密度BGA设计中，若必须采用Via-in-Pad，需对过孔进行塞孔+电镀填充处理，并在设计文件中明确标注工艺要求；
- 普通设计中，过孔与焊盘中心间距建议≥0.5mm。
三、立碑问题的成因与PCB设计阶段的预防策略
1. 两端焊盘热容量差异过大
立碑的本质是：片式元件两端焊盘在回流焊时，一端焊膏先熔化产生表面张力，将元件"拉起"竖立。设计阶段的热不对称是主要触发因素。
设计建议：
- 0201、0402等小尺寸贴片元件，两端焊盘的铜箔走线长度、宽度应保持高度一致；
- 避免将小元件的一侧焊盘紧邻大面积铜皮，若无法避免，在铜皮连接处增加缩颈（Neck-in）走线，降低散热不对称性。
2. 元件布局方向不合理
回流焊炉的温度梯度是单向的，元件方向与过炉方向的关系直接影响两端升温差异。
设计建议：
- 片式元件（尤其0402以下）建议垂直于过炉方向放置，确保两端焊盘同时进入同一温区；
- 参考IPC-7525《钢网设计指南》合理规划元件排列方向。
3. 钢网开口设计失当
钢网开口面积直接决定焊膏量。两端开口面积不一致，会导致焊膏体积差异，进而引发立碑。
设计建议：
- 钢网开口面积比（Aperture Ratio）通常控制在焊盘面积的85%～100%；
- 采用阶梯钢网针对不同元件分区控制焊膏厚度，是高精密板卡的有效方案。
四、高精密PCB设计的延伸注意事项
除虚焊与立碑外，以下设计细节同样影响PCBA打样直通率，值得重视：
- DFM（可制造性设计）审查：在PCB Layout完成后，应进行系统性DFM检查，包含最小间距、阻焊开窗、丝印与焊盘重叠等；
- 盲孔/埋孔设计：多层高密度板的盲埋孔须考虑孔径深径比（建议≤1:1），避免电镀不良导致的开路；
- BOM准确性：BOM表中器件封装与PCB Footprint一一对应，是避免打样阶段因选件错误导致焊接缺陷的基础保障；
- 阻抗控制设计：高速信号板须在设计阶段完成阻抗叠层计算，并在制造文件中明确标注阻抗要求，避免因板材或铜厚偏差引发信号完整性问题。
五、深圳宏力捷电子：从设计源头把控品质的一站式PCB服务商
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1. PCB设计画板：承接多层板、高精密板、BGA封装、盲孔/埋孔PCB Layout，客户提供原理图即可；
2. DFM审查：设计完成后进行可制造性审查，从源头降低虚焊、立碑等缺陷风险；
3. BOM建立与选型：协助建立完整BOM表，主动匹配可靠供应商，规避假料与断货风险；
4. PCB打样：快速打样，支持小批量试产，缩短研发验证周期；
5. PCBA代工代料：提供元器件采购+SMT贴片+插件焊接+测试的完整代工服务；
6. 批量生产：具备稳定的批量PCBA生产能力，品质与交期双重保障。
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